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30 lines
822 B
Verilog
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822 B
Verilog
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//# Function: Binary to one hot encoder #
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//# Author: Andreas Olofsson #
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//# License: MIT (see LICENSE file in OH! repository) #
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module oh_bitreverse #(parameter DW = 32 // width of data inputs
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)
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(
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input [DW-1:0] in, // data input
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output [DW-1:0] out // bit reversed output
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);
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reg [DW-1:0] out;
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integer i;
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always @*
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for (i=0;i<DW;i=i+1)
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out[i]=in[DW-1-i];
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endmodule // oh_bitreverse
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