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30 lines
1020 B
Verilog
30 lines
1020 B
Verilog
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//# Function: Buffer #
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//# Author: Andreas Olofsson #
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//# License: MIT (see LICENSE file in OH! repository) #
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module oh_buffer
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#(parameter N = 1, // vector width
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parameter SYN = "TRUE", // synthesize buffer
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parameter TYPE = "DEFAULT") // buffer type
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(
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input [N-1:0] in, // input
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output [N-1:0] out // output
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);
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generate
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if(SYN == "TRUE") begin
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assign out[N-1:0] = in[N-1:0];
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end
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else begin
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genvar i;
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for (i=0;i<N;i=i+1) begin
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asic_buffer #(.TYPE(TYPE))
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asic_buffer (.out (out[N-1:0]),
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.in (in[N-1:0]));
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end
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end
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endgenerate
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endmodule // oh_buffer
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