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563 B
Verilog
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563 B
Verilog
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//# Function: And-Or (ao311) Gate #
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//# Copyright: OH Project Authors. ALl rights Reserved. #
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//# License: MIT (see LICENSE file in OH repository) #
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module asic_ao311
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(
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input a0,
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input a1,
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input a2,
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input b0,
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input c0,
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output z
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);
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assign z = (a0 & a1 & a2) | b0 | c0;
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endmodule
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