mirror of
https://github.com/aolofsson/oh.git
synced 2025-01-30 02:32:53 +08:00
16 lines
488 B
Verilog
16 lines
488 B
Verilog
//#############################################################################
|
|
//# Function: Clock Inverter #
|
|
//# Copyright: OH Project Authors. ALl rights Reserved. #
|
|
//# License: MIT (see LICENSE file in OH repository) #
|
|
//#############################################################################
|
|
|
|
module asic_clkinv
|
|
(
|
|
input a,
|
|
output z
|
|
);
|
|
|
|
assign z = ~a;
|
|
|
|
endmodule
|