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17 lines
507 B
Verilog
17 lines
507 B
Verilog
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//# Function: 2-Input Clock Xor Gate #
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//# Copyright: OH Project Authors. ALl rights Reserved. #
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//# License: MIT (see LICENSE file in OH repository) #
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module asic_clkxor2
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(
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input a,
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input b,
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output z
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);
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assign z = a ^ b;
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endmodule
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