mirror of
https://github.com/aolofsson/oh.git
synced 2025-02-07 06:44:09 +08:00
27 lines
743 B
Verilog
27 lines
743 B
Verilog
//#############################################################################
|
|
//# Function: 4:1 one hot mux #
|
|
//#############################################################################
|
|
//# Author: Andreas Olofsson #
|
|
//# License: MIT (see LICENSE file in OH! repository) #
|
|
//#############################################################################
|
|
|
|
module asic_dmux4
|
|
(
|
|
input sel3,
|
|
input sel2,
|
|
input sel1,
|
|
input sel0,
|
|
input in3,
|
|
input in2,
|
|
input in1,
|
|
input in0,
|
|
output out
|
|
);
|
|
|
|
assign out = sel0 & in0 |
|
|
sel1 & in1 |
|
|
sel2 & in2 |
|
|
sel3 & in3;
|
|
|
|
endmodule
|