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38 lines
815 B
Verilog
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815 B
Verilog
module oh_gray2bin (/*AUTOARG*/
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// Outputs
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bin,
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// Inputs
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gray
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);
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//###############################################################
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//# Interface
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//###############################################################
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input [DW-1:0] gray; //gray encoded input
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output [DW-1:0] bin; //binary encoded output
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parameter DW = 64; //width of converter
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//###############################################################
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//# BODY
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//###############################################################
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reg [DW-1:0] bin;
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integer i,j;
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always @*
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begin
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bin[DW-1] = gray[DW-1];
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for (i=0; i<(DW-1); i=i+1)
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begin
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bin[i] = 1'b0;
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for (j=i; j<DW; j=j+1)
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bin[i] = bin[i] ^ gray [j];
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end
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end
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endmodule // oh_gray2bin
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