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9e41b55f22
-Can be used to select between different cells (like sizes) that have the exact same logical function
18 lines
650 B
Verilog
18 lines
650 B
Verilog
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//# Function: 2:1 Clock Mux #
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//# Author: Andreas Olofsson #
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//# License: MIT (see LICENSE file in OH! repository) #
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module asic_clkmux2 #(parameter PROP = "DEFAULT") (
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input clk0,
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input clk1,
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input sel,
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output z
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);
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assign z = sel ? clk0 : clk1;
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endmodule
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